减低Cache的缺失损失
提高Cache的命中率
减低CPU平均访问时间
减少指令流水线资源冲突
第1题:
PC中CPU执行MOV指令从存储器读取数据时,数据搜索的顺序是( )
A.L1 cache、12 cache、DRAM和外设
B.L2 cache、L1 cache、DRAM和外设
C.DRAM、外设、L2cache和L1 cache
D.外设、DRAM、L1 cache和L2 cache
第2题:
在分析Cache对机器性能的影响时,正确的叙述是( )。
A.Cache容量比主存小许多,决定机器访问存储器速度的是主存,Cache只起次要作用
B.CPU访问存储器时不受Cache控制器的控制
C.Cache存储器中保存着CPU当前频繁访问的指令代码和数据
D.奔腾PC机采用两极Cache结构,一级放指令,一级放数据
第3题:
第4题:
第5题:
第6题:
第7题:
Cache是一种()的存储器,位于CPU和主存之间,用来存放CPU正在使用的指令和数据;使用Cache的目的是提高CPU访问存储器的存取速度,减少处理器的等待时间。
第8题:
关于高速缓冲存储器cache的描述,不正确的是()
第9题:
Cache做在CPU芯片内有什么好处?将指令Cache和数据Cache分开又有什么好处?
第10题:
CPU执行指令需要从存储器读取数据时,数据搜索的先后顺序是()
第11题:
12ns
15ns
18ns
120ns
第12题:
减低Cache的缺失损失
提高Cache的命中率
减低CPU平均访问时间
减少指令流水线资源冲突
第13题:
在多级存储系统中,Cache处在CPU和主存之间,解决(55)问题。若Cache和主存的存取时间分别为T1和T2,Cache的命中率为H,则该计算机实际存取时间为(56)。当CPU向存储器执行读操作时,首先访问Cache,若命中,则从Cache中取出指令或数据,否则从主存中取出,送(57):当CPU向存储器执行写操作时,为了使Cache的内容和主存的内容保持一致,若采用(58)法,则同时写入Cache和主存。由于Cache容量比主存容量小,因此当Cache满时,执行把主存信息向Cache写入,就要淘汰Cache中已有的信息,为了提高Cache的命中率,采用一种(59)替换算法。
A.主存容量扩充
B.主存和CPU速度匹配
C.多个请求源访问主存
D.BIOS存放
第14题:
在主存和CPU之间增加Cache的目的是(17)。在CPU执行一段程序的过程中,Cache的存取次数为2250次,由内存完成的存取次数为250次。若Cache的存取周期为6ns,内存的存取周期为24ns,则Cache的命中率为(18),CPU的平均访问时间为(19)ns。
A.提高内存工作的可靠性
B.扩展内存容量
C.方便用户操作
D.提高CPU数据传输速率
第15题:
第16题:
第17题:
第18题:
已知cache存储周期为20ns,主存存储周期为220ns,cache/主存系统平均访问时间为60ns,则cache命中率是()。
第19题:
Cache的命中率是指命中Cache的次数与访问Cache的次数之比。
第20题:
将指令Cache和数据Cache分开又有什么好处?
第21题:
某计算机的存储系统由Cache、主存和用于虚拟存储的磁盘组成。CPU总是从Cache中获取数据。若所访问的字在Cache中,则存取它只需要20ns,将所访问的字从主存装入Cache需要60ns,而将它从磁盘装入主存则需要1200us。假定Cache的命中率为90%,主存的命中率为60%,计算该系统访问一个字的平均存取时间。
第22题:
第23题:
第24题:
对
错