以下关于CPU与主存之间增加高速缓存(Cache)的叙述中,错误的是______。A.Cache扩充了主存储器的容量B.Cache可以降低由于CPU与主存之间的速度差异造成的系统性能影响C.Cache的有效性是利用了对主存储器访问的局部性特征D.Cache中通常保存着主存储器中部分内容的一份副本

题目

以下关于CPU与主存之间增加高速缓存(Cache)的叙述中,错误的是______。

A.Cache扩充了主存储器的容量

B.Cache可以降低由于CPU与主存之间的速度差异造成的系统性能影响

C.Cache的有效性是利用了对主存储器访问的局部性特征

D.Cache中通常保存着主存储器中部分内容的一份副本


相似考题
参考答案和解析
正确答案:A
解析:本题考查计算机系统基础知识。
Cache(高速缓冲存储器)是一种特殊的存储器子系统,其中复制了频繁使用的数据以利于快速访问。Cache的出现是基于两种因素:首先,是由于CPU的速度和性能提高很快而主存速度较低且价格高,第二就是程序执行的局部性特点。因此,才将速度比较快而容量有限的SRAM构成Cache,目的在于尽可能发挥CPU的高速度。
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  • 第1题:

    以下关于CPU与主存之问增加高速缓存(Cache)的叙述中,错误的是______。

    A.Cache扩充了主存储器的容量

    B.Cache可以降低由于CPU与主存之间的速度差异造成的系统性能影响

    C.Cache的有效性是利用了对主存储器访问的局部性特征

    D.Cache中通常保存着主存储器中部分内容的一份副本

    A.

    B.

    C.

    D.


    正确答案:A
    解析:本题考查计算机系统基础知识。
      Cache(高速缓冲存储器)是一种特殊的存储器子系统,其中复制了频繁使用的数据以利于快速访问。Cache的出现是基于两种原因:首先是由于CPU的速度和性能提高很快而主存速度较低且价格高,其次就是程序执行的局部性特点。因此,将速度比较快而容量有限的SRAM构成Cache,目的在于尽可能发挥CPU的高速度。

  • 第2题:

    下面是关于CPU与主存储器之间的cache的叙述,其中正确的是( )。

    A.cache中存放的只是主存储器中部分内容的映像

    B.cache的工作方式可以根据需要由软件进行设置

    C.cache与主存储器是两个各自独立的存储部件,可以选择使用其中的一个

    D.cache通常是由DRAM制作的


    正确答案:A
    解析:cache中存放的只是主存储器中部分内容的映像,其他三种说法均不正确。

  • 第3题:

    以下关于高速缓存(Cache)的叙述中,错误的是()。

    A.在CPU和主存之间加入Cache的目的是为了扩大主存的容量

    B.Cache对于程序员来说是透明的,但程序员可利用Cache机制编写高效代码

    C.Cache是主存储器的高速缓存,Cache中的数据在主存中有备份

    D.在主存和Cache之间交换数据以一个主存块为单位


    D

  • 第4题:

    以下关于CPU与主存之问增加高速缓存(cache)的叙述,不正确的是______。

    A.Cache扩充了主存储器的容量

    B.Cache可以降低由于CPU与主存之间的速度差异造成的系统性能影响

    C.Cache的有效性是利用了对主存储器访问的局部性特征

    D.Cache中通常保存着主存储器中部分内容的一份副本


    正确答案:A
    解析:本题考查计算机系统基础知识。
    Cache(高速缓冲存储器)是一种特殊的存储器子系统,其中复制了频繁使用的数据以利于快速访问。Cache的出现是基于两种原因:酋先是由于CPU的速度和性能提高很快而主存速度较低且价格高,其次就是程序执行的局部性特点。因此,才将速度比较快而容量有限的SRAM构成(Cache,目的在于尽可能发挥CPU的高速度。

  • 第5题:

    以下关于CPU与主存之间增加高速缓存(Cache)的叙述,不正确的是()




    A. Cache扩充了主存储器的容量
    B. Cache可以降低由于CPU与主存之间的速度差异造成的系统性能影响
    C. Cache的有效性是利用了对主存储器访问的局部性特征
    D. Cache中通常保存着主存储器中部分内容的一份副本

    答案:A
    解析:
    Cache(高速缓冲存储器)是一种特殊的存储器子系统,其中复制了频繁使用的数据以利于快速访问。Cache的出现是基于两种原因:首先是由于CPU的速度和性能提高很快而主存速度较低且价格高,其次就是程序执行的局部性特点。因此,才将速度比较快而容量有限的SRAM构成Cache,目的在于尽可能发挥CPU的高速度。