参考答案和解析
正确答案:
    
更多“卡诺图写出逻辑表达使。(威盛VIA 2003.11.06 上海笔试试题)”相关问题
  • 第1题:

    说说静态、动态时序模拟的优缺点。(威盛VIA 2003.11.06 上海笔试试题)


    正确答案:
          

  • 第2题:

    画出CMOS的图,画出tow-to-one mux gate。(威盛VIA 2003.11.06 上海笔试试题)


    正确答案:
                  

  • 第3题:

    一个状态机的题目用verilog实现(不过这个状态机画的实在比较差,很容易误解的)。(威盛VIA 2003.11.06 上海笔试试题)


    正确答案:
           

  • 第4题:

    对于卡诺图,下列说法正确的是(14)。

    A.卡诺图是用来化简逻辑表达式的有效手段

    B.卡诺图化简逻辑表达式时,只能合并卡诺图中的1

    C.卡诺图化简逻辑表达式时,只能合并卡诺图中的0

    D.卡诺图能减少逻辑错误


    正确答案:A
    解析:卡诺图是逻辑函数的一种图形表示。将一个逻辑函数的最小项表达式中的各最小项相应地填入一个方框图内,此方框图称为卡诺图。卡诺图的构造特点使卡诺图具有一个重要性质:可以从图形上直观地找出相邻最小项,两个相邻最小项可以合并为一个“与”项并消去一个变量。用卡诺图化简逻辑函数的基本原理就是把上述逻辑依据和图形特征结合起来,通过把卡诺图上表征相邻最小项的相邻小方格“圈”在一起进行合并,达到用一个简单“与”项代替若干最小项的目的。

  • 第5题:

    Please explain how we describe the resistance in semiconductor. Compare the resistance of a metal,poly and diffusion in tranditional CMOS process.(威盛笔试题circuit design-beijing-03.11.09)


    正确答案:
            

  • 第6题:

    用一种编程语言写n!的算法。(威盛VIA 2003.11.06 上海笔试试题)


    正确答案:
        

  • 第7题:

    说出你的理想。说出你想达到的目标。 题目是英文出的,要用英文回答。(威盛VIA

    2003.11.06 上海笔试试题)


    正确答案:
          

  • 第8题:

    Please draw schematic of a common SRAM cell with 6 transistors,point out

    which nodes can store data and which node is word line control? (威盛笔试题

    circuit design-beijing-03.11.09)


    正确答案:
                 

  • 第9题:

    已知函数的逻辑表达式怎样得到它的卡诺图?


    正确答案:如果逻辑函数表达式是最小项之和的形式,则只要在卡诺图上找出那些同给定逻辑函数包含的最小项相对应的小方格,并标以1,剩余小方格标以0,就得到该函数的卡诺图。

  • 第10题:

    用卡诺图化简逻辑函数的步骤除了将函数化简为最小项之和的形式外还有()。

    • A、画出表示该逻辑函数的卡诺图
    • B、找出可以合并的最小项
    • C、写出最简“与或”逻辑函数表达式
    • D、写出最简“与或非”逻辑函数表达式

    正确答案:A,B,C

  • 第11题:

    常用的逻辑函数的表示方法有()。 

    • A、逻辑函数表达式
    • B、真值表
    • C、卡诺图
    • D、逻辑图
    • E、时序图
    • F、符号图

    正确答案:A,B,C,D

  • 第12题:

    多选题
    常用的逻辑函数的表示方法有()。
    A

    逻辑函数表达式

    B

    真值表

    C

    卡诺图

    D

    逻辑图

    E

    时序图

    F

    符号图


    正确答案: C,D
    解析: 暂无解析

  • 第13题:

    一个四级的Mux,其中第二级信号为关键信号如何改善timing。(威盛VIA2003.11.06上海笔试试题)


    正确答案:

     

     

  • 第14题:

    用逻辑们画出D触发器。(威盛VIA 2003.11.06 上海笔试试题)


    正确答案:
     

  • 第15题:

    Please draw schematic of a common SRAM cell with 6 transistors,point out which nodes can store data and which node is word line control? (威盛笔试题circuit design-beijing-03.11.09)


    正确答案:
                 

  • 第16题:

    Asic的design flow。(威盛VIA 2003.11.06 上海笔试试题)


    正确答案:
      

  • 第17题:

    cache的主要部分什么的。(威盛VIA 2003.11.06 上海笔试试题)


    正确答案:
        

  • 第18题:

    C语言实现统计某个cell在某.v文件调用的次数(这个题目真bt) (威盛VIA2003.11.0

    6 上海笔试试题)


    正确答案:
               

  • 第19题:

    解释setup和hold time violation,画图说明,并说明解决办法。(威盛VIA 2003.11.06 上海笔试试题)


    正确答案:

              

    Setup/hold time 是测试芯片对输入信号和时钟信号之间的时间要求。建立时间是指触发器的时钟信号上升沿到来以前,数据稳定不变的
    时间。输入信号应提前时钟上升沿(如上升沿有效)T时间到达芯片,这个T就是建立时间-Setup time.如不满足setup time,这个数据就不能被这一时钟打入触发器,只有在下一个时钟上升沿,数据才能被打入触发器。保持时间是指触发器的时钟信号上升沿到来以后,数据稳定不变的时间。如果hold time 不够,数据同样不能被打入触发器。
    建立时间(Setup Time)和保持时间(Hold time)。建立时间是指在时钟边沿前,数据信号需要保持不变的时间。保持时间是指时钟跳变边沿后数据信号需要保持不变的时间。如果不满足建立和保持时间的话,那么DFF将不能正确地采样到数据,将会出现 metastability的情况。如果数据信号在时钟沿触发前后持续的时间均超过建立和保持时间,那么超过量就分别被称为建立时间裕量和保持时间裕量。

  • 第20题:

    下列说法,()不是逻辑函数的表示方法。

    • A、真值表和逻辑表达式
    • B、卡诺图和逻辑图
    • C、波形图和状态图
    • D、真值表和逻辑图

    正确答案:C

  • 第21题:

    下列说法中,()不是逻辑函数的表示方法。

    • A、真值表和逻辑表达式
    • B、卡诺图和逻辑图
    • C、波形图和状态图

    正确答案:C

  • 第22题:

    组合电路逻辑功能的表示方法有()。

    • A、真值表
    • B、卡诺图
    • C、逻辑表达式
    • D、时序图

    正确答案:A,B,C,D

  • 第23题:

    多选题
    组合电路逻辑功能的表示方法有()。
    A

    真值表

    B

    卡诺图

    C

    逻辑表达式

    D

    时序图


    正确答案: C,B
    解析: 暂无解析